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W9412G6IH
6. BLOCK DIAGRAM
CLK
CLK
DLL
CLOCK
BUFFER
CKE
CS
CONTROL
SIGNAL
RAS
CAS
COMMAND
DECODER
GENERATOR
WE
A10
MODE
COLUMN DECODER
CELL ARRAY
BANK #0
COLUMN DECODER
CELL ARRAY
BANK #1
A0
REGISTER
SENSE AMPLIFIER
SENSE AMPLIFIER
ADDRESS
A9
A11
BA0
BA1
BUFFER
PREFETCH REGISTER
DATA CONTROL
CIRCUIT
DQ
BUFFER
DQ0
DQ15
REFRESH
COUNTER
COLUMN
COUNTER
LDQS
UDQS
LDM
UDM
COLUMN DECODER
COLUMN DECODER
CELL ARRAY
CELL ARRAY
BANK #2
BANK #3
SENSE AMPLIFIER
SENSE AMPLIFIER
NOTE: The cell array configuration is 4096 * 512 * 16
Publication Release Date: Sep. 16, 2009
-8-
Revision A06
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